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《完整電子設計套裝附加組件》(Altera.Complete.Design.Suite)v11.1.Devices.Addon[光盤鏡像]
下載分級 软件资源
資源類別 行業軟件
發布時間 2017/7/17
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《完整電子設計套裝附加組件》(Altera.Complete.Design.Suite)v11.1.Devices.Addon[光盤鏡像] 簡介: 資料介紹 相關專題學習資料: 電子技
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語言:英語
網址:http://www.altera.com/products/s ... -qts-whats-new.html
類別:完整電子設計套裝附加組件



(from:NET)
Altera Complete Design Suite V11.1 完整設計套裝包含Quartus II V11.1邏輯設計軟件、Nios II 嵌入式設計軟件、ModelSim-Altera仿真工具、DSP Builder系統開發工具和各類MegaCore IP內核庫。

Quartus II V11.1 邏輯設計軟件

Quartus II新版軟件11.1支持最新的28-nm Arria V和Cyclone V器件,還增強了對Stratix V器件的支持。其他特性包括獨特的調試和演示工具“系統控制台”,以及增強Qsys系統集成工具。

Quartus II 軟件11.1版提供對Arria V FPGA和Cyclone V FPGA的編譯支持。在中端應用中,Arria V FPGA在功耗、性能和系統成本上達到均衡。在28-nm FPGA中,Cyclone V FPGA功耗最低,而且系統成本最低。這一版本軟件還提供對Altera高端28-nm Stratix V FPGA的更多支持,包括,對PCI Express PCIe Gen3的支持,以及DDR3/QDRII存儲器的比特流產生功能等。

Quartus II軟件11.1版的其他特性包括:
● 收發器工具包——Quartus II軟件11.1版支持Stratix V FPGA收發器的片內EyeQ信號質量監視功能,使用戶能夠分析後均衡收發器眼圖,獲得最佳信號質量,降低BER。
● Qsys增強功能——這一版本增加了對第三方仿真工具的擴展支持,還包括對ARM AMBA AXI協議的初步支持。
● SoC設計環境——Quartus II軟件11.1版包括初步的集成SoC設計環境,能夠與Altera SoC FPGA進行硬件/軟件協同設計,用戶能夠在處理器和FPGA開發中使用熟悉的工具和開發流程,加速設計過程,從而提高了效能。

Nios II 嵌入式軟件設計工具

Nios II嵌入式設計包(EDS)組合了前沿的軟件工具、實用工具、庫和驅動器,幫助您以最短的時間將設計推向市場。
在v11.1版Altera完整設計套裝中,Nios II EDS含在Quartus II軟件v11.1下載中,因此,不需要單獨下載或者安裝。 Nios II EDS包括Eclipse Nios II軟件構建工具(SBT),它是下一代Nios II IDE。
Nios II嵌入式設計包包括:
● 為Eclipse提供的Nios II 軟件構建工具
● Nios軟件構建工具
● 嵌入式軟件
● Altera IP和HAL API器件驅動
● Nios II IDE (支持舊版)

ModelSim-Altera仿真工具

在你的FPGA 設計流程裡采用ModelSim-Altera軟件將縮短你的FPGA驗證時間。ModelSim-Altera 軟件為所有Altera器件提供行為級和門級仿真,包括VHDL或者Verilog測試台文件。該軟件支持具有3000個例化的設計,Altera預編譯庫中的例化不受3000個例化數量的限制。

DSP Builder系統開發設計工具

DSP Builder是一個數字信號處理(DSP)開發工具,它提供了Quartus II軟件和MATLAB/Simulink工具之間的接口。Altera的DSP系統體系解決方案是一項具有開創性的解決方案,它將FPGA的應用領域從多通道高性能信號處理擴展到很廣泛的基於主流DSP的應用,是Altera第一款基於C代碼的可編程邏輯設計流程。

利用DSP Builder技術,您在幾分鐘內就可以使用業界標准MathWorks/Simulink工具完成系統定義和仿真,直至系統實現。 DSP Builder信號編譯器模塊讀取由DSP Builder和MegaCore模塊構建的Simulink模型文件(.mdl),生成VHDL文件和Tcl腳本,進行綜合,實現硬件,並完成仿真。

代碼



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